CVE-2025-39961

In the Linux kernel, the following vulnerability has been resolved: iommu/amd/pgtbl: Fix possible race while increase page table level The AMD IOMMU host page table implementation supports dynamic page table levels (up to 6 levels), starting with a 3-level configuration that expands based on IOVA address. The kernel maintains a root pointer and current page table level to enable proper page table walks in alloc_pte()/fetch_pte() operations. The IOMMU IOVA allocator initially starts with 32-bit address and onces its exhuasted it switches to 64-bit address (max address is determined based on IOMMU and device DMA capability). To support larger IOVA, AMD IOMMU driver increases page table level. But in unmap path (iommu_v1_unmap_pages()), fetch_pte() reads pgtable->[root/mode] without lock. So its possible that in exteme corner case, when increase_address_space() is updating pgtable->[root/mode], fetch_pte() reads wrong page table level (pgtable->mode). It does compare the value with level encoded in page table and returns NULL. This will result is iommu_unmap ops to fail and upper layer may retry/log WARN_ON. CPU 0 CPU 1 ------ ------ map pages unmap pages alloc_pte() -> increase_address_space() iommu_v1_unmap_pages() -> fetch_pte() pgtable->root = pte (new root value) READ pgtable->[mode/root] Reads new root, old mode Updates mode (pgtable->mode += 1) Since Page table level updates are infrequent and already synchronized with a spinlock, implement seqcount to enable lock-free read operations on the read path.
Configurations

Configuration 1 (hide)

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History

19 Oct 2026, 21:10

Type Values Removed Values Added
Summary
  • (es) En el kernel de Linux, la siguiente vulnerabilidad ha sido resuelta: iommu/amd/pgtbl: Corrige una posible condición de carrera al aumentar el nivel de la tabla de páginas La implementación de la tabla de páginas de host de AMD IOMMU soporta niveles de tabla de páginas dinámicos (hasta 6 niveles), comenzando con una configuración de 3 niveles que se expande basándose en la dirección IOVA. El kernel mantiene un puntero raíz y el nivel actual de la tabla de páginas para permitir recorridos adecuados de la tabla de páginas en las operaciones alloc_pte()/fetch_pte(). El asignador IOVA de IOMMU inicialmente comienza con una dirección de 32 bits y una vez que se agota, cambia a una dirección de 64 bits (la dirección máxima se determina basándose en la capacidad DMA del IOMMU y del dispositivo). Para soportar IOVA más grandes, el controlador AMD IOMMU aumenta el nivel de la tabla de páginas. Pero en la ruta de desmapeo (iommu_v1_unmap_pages()), fetch_pte() lee pgtable->[root/mode] sin bloqueo. Así que es posible que en un caso extremo, cuando increase_address_space() está actualizando pgtable->[root/mode], fetch_pte() lea un nivel de tabla de páginas incorrecto (pgtable->mode). Compara el valor con el nivel codificado en la tabla de páginas y devuelve NULL. Esto resultará en que las operaciones iommu_unmap fallen y la capa superior puede reintentar/registrar WARN_ON. CPU 0 CPU 1 ------ ------ mapear páginas desmapear páginas alloc_pte() -> increase_address_space() iommu_v1_unmap_pages() -> fetch_pte() pgtable->root = pte (nuevo valor raíz) LEER pgtable->[mode/root] Lee nueva raíz, modo antiguo Actualiza el modo (pgtable->mode += 1) Dado que las actualizaciones del nivel de la tabla de páginas son poco frecuentes y ya están sincronizadas con un spinlock, se implementa seqcount para habilitar operaciones de lectura sin bloqueo en la ruta de lectura.

Information

Published : 2025-10-09 13:15

Updated : 2026-10-19 21:10


NVD link : CVE-2025-39961

Mitre link : CVE-2025-39961

CVE.ORG link : CVE-2025-39961


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Products Affected

linux

  • linux_kernel
CWE
CWE-362

Concurrent Execution using Shared Resource with Improper Synchronization ('Race Condition')